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      專(zhuān)題:vhdl課程設(shè)計(jì)報(bào)告

      • VHDL課程設(shè)計(jì)報(bào)告 頻率計(jì)

        時(shí)間:2019-05-14 02:04:32 作者:會(huì)員上傳

        目錄 1. 前言........................................................................................................................... 2 2. 設(shè)計(jì)要求...........

      • VHDL八位數(shù)碼管頻率計(jì)課程設(shè)計(jì)

        時(shí)間:2019-05-14 02:04:33 作者:會(huì)員上傳

        一、課程設(shè)計(jì)要求 設(shè)計(jì)一個(gè)8位數(shù)碼管顯示的頻率計(jì)(頻率分辨率為1Hz)。 二、總體結(jié)構(gòu)框圖 系統(tǒng)時(shí)鐘分頻及控制待測(cè)頻率計(jì)數(shù)數(shù)據(jù)鎖存動(dòng)態(tài)掃描數(shù)碼管段選數(shù)碼管位選數(shù)碼管顯示

      • 數(shù)字電路課程設(shè)計(jì)——用VHDL語(yǔ)言設(shè)計(jì)交通燈(五篇)

        時(shí)間:2019-05-14 03:33:36 作者:會(huì)員上傳

        數(shù)字電路課程設(shè)計(jì)報(bào)告 院系: 電氣信息工程學(xué)院 班級(jí): 08測(cè)控2班 學(xué)號(hào): 08314237 姓名: 董 亮 合作: 虞 波 指導(dǎo)教師: 翟 麗 芳 2010年12月10日 第 0 頁(yè) 共 17 頁(yè) 目 錄 引言··

      • 多功能數(shù)字鐘課程設(shè)計(jì)VHDL代碼書(shū)上程序改

        時(shí)間:2019-05-14 18:42:57 作者:會(huì)員上傳

        library ieee; use ieee.std_logic_1164.all; entity clock is port( clk1hz:in std_logic;--1hz脈沖-- clk100:in std_logic;--100hz脈沖-- weekclk:in std_logic;--星期調(diào)

      • VHDL實(shí)驗(yàn)報(bào)告

        時(shí)間:2019-05-14 03:22:03 作者:會(huì)員上傳

        《創(chuàng)新實(shí)驗(yàn)》實(shí)驗(yàn)報(bào)告 —基于VHDL的編程和硬件實(shí)現(xiàn) 一、實(shí)驗(yàn)?zāi)康?1. 2. 3. 4. 熟悉和掌握硬件描述語(yǔ)言VHDL的基本語(yǔ)法及編寫(xiě); 掌握軟件Xilinx ISE 10.1的使用; 熟悉SDZ-6電子

      • VHDL體會(huì)

        時(shí)間:2019-05-12 13:08:52 作者:會(huì)員上傳

        學(xué)習(xí)心得 ——《eda技術(shù)實(shí)用教程》本學(xué)期對(duì)《eda技術(shù)實(shí)用教程--vhdl版》的學(xué)習(xí)為我的專(zhuān)業(yè)知識(shí)學(xué)習(xí)打開(kāi)了一個(gè)全新的窗口——微電子技術(shù)領(lǐng)域。對(duì)eda技術(shù),我更是有了全新的認(rèn)

      • VHDL簡(jiǎn)答題總結(jié)

        時(shí)間:2019-05-12 05:34:50 作者:會(huì)員上傳

        1 數(shù)據(jù)BIT與STD_LOGIC的區(qū)別? Bit只是一個(gè)邏輯型變量,只能存在“0”和“1”,不存在不定狀態(tài)和高阻態(tài) STD_LOGIC存在U初始值,X不定,0,1,Z高阻 W弱信號(hào)不定,L弱信號(hào)1,H弱信號(hào)0,-不可能

      • VHDL實(shí)現(xiàn)數(shù)字鐘課設(shè)報(bào)告[推薦]

        時(shí)間:2019-05-13 23:58:02 作者:會(huì)員上傳

        東北大學(xué)信息學(xué)院 課程設(shè)計(jì)報(bào)告 課程設(shè)計(jì)題目:用VHDL語(yǔ)言實(shí)現(xiàn)數(shù)字鐘的設(shè)計(jì) 班 級(jí):電子1001班 學(xué) 號(hào):20102594 姓 名:劉云飛 指導(dǎo)老師:李世平、李寧設(shè)計(jì)時(shí)間:2012年12月1 東北大

      • 基于VHDL的多功能數(shù)字鐘設(shè)計(jì)報(bào)告

        時(shí)間:2019-05-12 07:07:03 作者:會(huì)員上傳

        基于VHDL的多功能數(shù)字鐘 設(shè)計(jì)報(bào)告 021215班 衛(wèi)時(shí)章 02121451 一、設(shè)計(jì)要求 1、具有以二十四小時(shí)制計(jì)時(shí)、顯示、整點(diǎn)報(bào)時(shí)、時(shí)間設(shè)置和鬧鐘的功能。 2、設(shè)計(jì)精度要求為1秒。

      • 用狀態(tài)機(jī)實(shí)現(xiàn)的EDA多功能數(shù)字鐘課程設(shè)計(jì)VHDL代碼

        時(shí)間:2019-05-14 18:42:57 作者:會(huì)員上傳

        設(shè)計(jì)并實(shí)現(xiàn)具有一定功能的數(shù)字鐘 1、該數(shù)字鐘可以實(shí)現(xiàn)3個(gè)功能:計(jì)時(shí)功能、整點(diǎn)報(bào)時(shí)功能和重置時(shí)間功能,因此有3個(gè)功能:計(jì)時(shí)、重置時(shí)間、復(fù)位。 2、對(duì)所有設(shè)計(jì)的小系統(tǒng)能夠正確分

      • 多功能數(shù)字鐘課程設(shè)計(jì)整點(diǎn)報(bào)時(shí)與鬧鐘功能VHDL代碼

        時(shí)間:2019-05-14 18:42:58 作者:會(huì)員上傳

        library IEEE; use IEEE.STD_LOGIC_1164.ALL; use IEEE.STD_LOGIC_ARITH.ALL; use IEEE.STD_LOGIC_UNSIGNED.ALL; -- Uncomment the following lines to use the declarat

      • 高頻課程設(shè)計(jì)報(bào)告

        時(shí)間:2019-05-14 00:00:44 作者:會(huì)員上傳

        一 設(shè)計(jì)課題名稱(chēng) 單邊帶調(diào)制解調(diào)電路的設(shè)計(jì) 二 課程設(shè)計(jì)目的、要求與技術(shù)指標(biāo) 2.1 課程設(shè)計(jì)目的 (1) 鞏固所學(xué)的相關(guān)理論知識(shí); (2) 掌握電子系統(tǒng)的一般設(shè)計(jì)方法; (3) 會(huì)運(yùn)用multisim

      • 課程設(shè)計(jì)報(bào)告(范文)

        時(shí)間:2019-05-13 04:11:03 作者:會(huì)員上傳

        一. 設(shè)計(jì)題目 WFS-601面包電話制作 二. 主要內(nèi)容 1、 分析面包電話機(jī)的功能,了解面包電話機(jī)的構(gòu)造 2、 完成面包電話機(jī)的焊接,要求焊點(diǎn)符合焊接要求。電話要實(shí)現(xiàn)接聽(tīng)與呼叫以及

      • 課程設(shè)計(jì)報(bào)告

        時(shí)間:2019-05-15 11:46:17 作者:會(huì)員上傳

        學(xué) 期:2014-2015-2 作 業(yè):課程設(shè)計(jì)社會(huì)調(diào)研報(bào)告 班 級(jí):社會(huì)工作131 學(xué) 號(hào):1325012029 姓 名:蔣葉青 指導(dǎo)老師:錢(qián)雪飛老師 一.簡(jiǎn)介 時(shí)間:2015.5.26-5.28 地點(diǎn):中國(guó)杭州

      • VHDL 編程的一些心得體會(huì)

        時(shí)間:2019-05-15 13:19:09 作者:會(huì)員上傳

        VHDL 編程的一些心得體會(huì)(轉(zhuǎn))

        VHDL 是由美國(guó)國(guó)防部為描述電子電路所開(kāi)發(fā)的一種語(yǔ)言,其全稱(chēng)為(Very High Speed Integrated Circuit) Hardware Description Language。 與另

      • 車(chē)站課程設(shè)計(jì)報(bào)告

        時(shí)間:2019-05-13 22:55:04 作者:會(huì)員上傳

        華東交通大學(xué)課程設(shè)計(jì)報(bào)告 車(chē)站信號(hào)控制系統(tǒng)課程設(shè)計(jì)報(bào)告 課題:基于AUTOCAD的電路圖繪制及聯(lián) 鎖表制作 學(xué)院:軌道交通學(xué)院 專(zhuān)業(yè): 交通設(shè)備信息工程 班級(jí):姓名:學(xué)號(hào):華東交通大

      • 計(jì)算機(jī)網(wǎng)絡(luò)課程設(shè)計(jì)報(bào)告

        時(shí)間:2019-05-14 02:19:50 作者:會(huì)員上傳

        目錄 需求分析…………………………………………….3 總體設(shè)計(jì)…………………………………………….3 詳細(xì)設(shè)計(jì)…………………………………………….4 測(cè)試的步驟………

      • 網(wǎng)絡(luò)課程設(shè)計(jì)報(bào)告

        時(shí)間:2019-05-14 02:19:52 作者:會(huì)員上傳

        《計(jì)算機(jī)網(wǎng)絡(luò)課程設(shè)計(jì)報(bào)告》 學(xué)院:計(jì)算機(jī)科學(xué)學(xué)院 專(zhuān)業(yè):計(jì)算機(jī)科學(xué)與技術(shù) 班級(jí): 姓名: 學(xué)號(hào): 小組成員: 2011-7-13 項(xiàng)目?jī)?nèi)容:基于Socket的文件傳輸服務(wù)設(shè)計(jì)與實(shí)現(xiàn) 實(shí)驗(yàn)?zāi)康模夯赟